阻变式随机存取存储器的制作方法

阻变式随机存取存储器
1.本技术是申请号为201780080601.x，申请日为2017年11月13日，发明名称为
″
减少掩模操作次数的rram工艺整合方案及单元结构
″
的专利申请的分案申请。
技术领域
2.本发明涉及一种阻变式随机存取存储器。


背景技术：

3.非易失性存储器是一种即使在断电后仍可存储信息的存储设备。非易失性存储(nvm)装置可以为只读存储器或随机存取存储器(ram)，并且可采用各种技术。非易失性ram当中的一类为阻变ram，其所含技术包括细丝阻变式存储器(rram或reram)单元，界面rram单元，磁阻性ram(mram)单元，相变存储(pcm)单元(如包括锗、锑、碲合金在内的硫族化物)，忆阻存储单元以及可编程金属化单元(如导电桥接ram(cbram)单元)。rram单元具有快速的操作时间和低功耗性能，因此在嵌入式应用和独立式应用中，成为一种前景广阔的非易失性存储装置。


技术实现要素：

4.根据一个实施例，本发明公开一种阻变式随机存取存储器(rram)，包括：由钨构成的一个或多个底电极；一个或多个转变层，由设于所述一个或多个底电极上方的氧化铪构成，所述一个或多个转变层包括可转变细丝；设于所述一个或多个转变层上方的一个或多个电阻层；以及设于所述一个或多个转变层下方的过孔，其中，所述过孔与所述转变层直接接触且所述过孔包括钨。
5.根据另一个实施例，本发明公开一种阻变式随机存取存储器(rram)，包括：一个或多个转变层；设于所述一个或多个转变层上方的一个或多个电阻层；设于所述一个或多个电阻层上方的一个或多个顶电极；以及设于所述一个或多个转变层下方的过孔，其中，所述过孔与所述一个或多个转变层直接接触且所述过孔包括钨。
附图说明
6.通过以下给出的详细描述和本发明各实施方式附图，可以更加全面地理解本发明。
7.图1所示为根据一种实施方式具有转变层的阻变式随机存取存储器(rram)结构，该转变层为平面层。
8.图2所示为根据一种实施方式具有横向延伸转变层的rram结构。
9.图3所示为根据一种实施方式具有非线性器件层的rram结构。
10.图4为根据一种实施方式用于制造rram结构的制造工艺流程图。
具体实施方式
11.下文中，将以本领域技术人员的通用术语，对各说明性实施方式的各个方面进行描述，以将其工作实质传达给本领域的其他技术人员。然而，对于本领域技术人员而言容易理解的是，本发明可仅以以下所描述的各个方面当中的一部分进行实施。为了使这些说明性实施方式能够被彻底理解，文中给出了用于解释目的的具体数字，材料和构造。然而，对于本领域技术人员而言容易理解的是，本发明在没有这些具体细节的情况下仍可实施。此外，为了避免模糊各说明性实施方式的描述焦点，文中省略了对本领域熟知特征的描述，或者仅对其进行简单描述。虽然本技术描述的各实施方式针对rram单元，但是在其他实施方式中，这些技术也可用于例如包括cbram单元、界面rram单元、mram单元、pcm单元或其他可编程金属化单元在内的其他细丝ram技术。
12.阻变式随机存取存储器(rram)为一种非易失性随机存取存储器。rram结构包括由导电材料形成的底电极。该rram结构还包括设于所述底电极上方的转变层。当该转变层上施加电压时，将在转变层中形成一个或多个氧空位(如可转变细丝)。这些氧空位可形成导通所述转变层的导电路径。因此，当形成氧空位时，所述转变层可处于低电阻状态。相反，当氧空位被破坏(如复位)时，该转变层可处于高电阻状态。所述转变层上方可设置电阻层。
13.所述rram结构的存储单元(以下也称
″
rram单元
″
)可形成于半导体装置的位线与字线交叉处或过孔上方。这些rram单元可通过刻蚀或等离子体工艺形成。所述电阻层上表面的一部分上可施加能够抵抗刻蚀化学物质或等离子体的掩模材料。所述转变层和电阻层可暴露于所述刻蚀化学物质或等离子体中，以形成所述rram单元。在所述刻蚀或等离子体工艺之后，所述电阻层上方可设置顶电极层，然后可在该顶电极层上表面的一部分上施加掩模材料。随后，可在所述顶电极层上实施第二次刻蚀或等离子体工艺，以形成所述rram结构的顶电极(如位线)。为了形成该rram结构的各rram单元，可能需要实施多次掩模操作，从而增加了所述rram结构的生产和制造成本，并提高了制造工艺的复杂性。此外，所述刻蚀或等离子体工艺可能会在所述rram单元周围留下多余材料，从而导致可降低rram单元性能和均一性的存储单元边缘效应。
14.本发明实施方式可通过使所述电阻层横向延伸跨过位线的多个存储单元，将rram结构制造所需的掩模和刻蚀操作次数减少至单次掩模和刻蚀操作，从而解决上述及其他问题。其中，所述顶电极层可直接设于所述电阻层上方，无需在该电阻层上实施掩模和刻蚀操作。然后，在所述顶电极层和电阻层上实施单次掩模和刻蚀操作即可，从而降低了所述rram结构的生产和制造成本。此外，通过减少可由所述刻蚀或等离子体工艺去除的材料量，还可减少刻蚀操作后存在于rram单元周围的多余材料量，从而降低存储单元边缘效应，并提高存储单元性能和均一性。除了上述优点之外，本发明实施方式还具有其他优点。
15.图1所示为根据一种实施方式具有转变层的rram结构100，该转变层为平面层。rram结构100可包括半导体结构110。该半导体结构可包括过孔150，这些过孔用作转变层120与下方的半导体装置110部件之间的垂向导电路径。在一种实施方式中，过孔150可由导电材料形成。该导电材料的例子包括，但不限于，铜，金，银，钨或类似材料。由于钨易于在当转变层120在高电阻状态和低电阻状态之间切换(反之亦然)时被氧化(例如，氧被钨捕获而形成氧化钨)，因此钨形成的过孔150可提高rram结构100的性能，以下将对此进行进一步的详细描述。在一些实施方式中，可通过优化算法对钨的氧化进行控制，以改善rram结构100
的耐久性。
16.所述半导体装置和过孔150上方可设置转变层120。转变层120可通过化学气相沉积法(cvd)，原子层沉积法(ald)或任何合适方法设置。在一种实施方式中，转变层120可由过渡金属氧化物(tmo)等介电材料形成。tmo的例子包括，但不限于，化学计量氧化铪(hfox)、化学计量氧化钽(taox)或其他类似材料。转变层120可包括一个或多个氧空位160，该氧空位可用作导通转变层120的导电路径。在一种实施方式中，氧空位160可用作过孔150和电阻层130之间的导电路径。在一些实施方式中，可形成金属导电细丝，而非通过在转变层120上施加电压而形成氧空位160。氧空位160可通过在转变层120上施加电压的方式形成。转变层120可具有电阻值，其中，该电阻值可在施加电压时发生变化。举例而言，当施加电压时，转变层120可在高电阻状态和低电阻状态之间切换。在一种实施方式中，所述高电阻状态可介于100～500千欧(含此两值)之间，所述低电阻状态可介于10～30千欧(含此两值)之间。在一些实施方式中，所述高电阻状态与低电阻状态之比可大于1。例如，如果所述高电阻状态下的电阻为100千欧，且所述低电阻状态下的电阻为10千欧，则所述比值可以为10(如100千欧/10千欧)。在一些实施方式中，所述高电阻状态与低电阻状态之比可大于10。在一种实施方式中，转变层120可以为设于半导体装置110和过孔150上方的平面层。
17.转变层120上方可设置电阻层130。电阻层130可通过cvd，ald或任何合适方法设置。在一种实施方式中，电阻层130可以为导电材料。在另一实施方式中，电阻层130可以为导电金属氧化物(cmo)。电阻层130可横向延伸，从而通过转变层120与两个或更多个过孔150连接。在一些实施方式中，每一过孔150均可对应于存储单元，而且电阻层130可横向延伸，从而沿顶电极140与两个或更多个存储单元连接。在一种实施方式中，过孔150可与n型金属氧化物半导体(nmos)晶体管的漏极连接。顶电极140可设于电阻层130上方。顶电极140可以为导电材料。该导电材料的例子包括，但不限于，铝，铜或任何类似材料。顶电极140可通过cvd，ald或任何合适方法设于电阻层130上方，从而在过孔150和顶电极140的交叉处形成存储单元170，180。顶电极140可沿电阻层130横向延伸。在一些实施方式中，顶电极140可以为位线，电阻层130可沿该位线与两个或更多个存储单元连接。例如，电阻层130和顶电极140可横向延伸，从而将存储单元170连接于存储单元180。在一些实施方式中，顶电极140对应于用于所述半导体器件的其他连接结构的标准金属化层。虽然本发明实施方式将转变层120和电阻层130示为处于过孔150和顶电极140之间，但是在其他实施方式中，转变层120和电阻层130可位于半导体结构的任何过孔和任何金属层之间。
18.图2所示为根据一种实施方式具有横向延伸转变层的rram结构200。rram结构200可包括半导体结构210。该半导体结构可包括过孔250，这些过孔用作转变层220与下方的半导体装置210部件之间的垂向导电路径。在一种实施方式中，过孔250可由钨等导电材料形成。所述半导体装置和过孔250上方可设置转变层220。转变层220可通过cvd，ald或任何合适方法设置。在一种实施方式中，转变层220可以为介电材料。在另一实施方式中，转变层220可以为tmo。在其他实施方式中，转变层220可以为hfox，taox，tiox或其他类似材料。转变层220可包括一个或多个氧空位260，该氧空位可用作导通转变层220的导电路径。氧空位260可通过在转变层220上施加电压的方式形成。转变层220可具有在施加电压时发生变化的电阻值。举例而言，当施加电压时，转变层220可在高电阻状态和低电阻状态之间切换。在一种实施方式中，转变层220可横向延伸于两个或更多个过孔250的上方。
19.转变层220上方可设置电阻层230。电阻层230可通过cvd，ald或其他方法设置。在一种实施方式中，电阻层230可以为导电材料。在另一实施方式中，电阻层230可以为cmo。电阻层230可横向延伸，从而通过转变层220与两个或更多个过孔250连接。在一些实施方式中，每一过孔250均可对应于存储单元，而且电阻层230可横向延伸，从而沿顶电极240与两个或更多个存储单元连接。在一种实施方式中，过孔250可与n型金属氧化物半导体(nmos)晶体管的漏极连接。顶电极240可设于电阻层230上方。顶电极240可以为导电材料。该导电材料的例子包括，但不限于，铝，铜或任何类似材料。顶电极240可通过cvd，ald或任何合适方法设于电阻层230上方，从而在过孔250和顶电极240的交叉处形成存储单元270，280。顶电极240可沿电阻层230横向延伸。在一些实施方式中，顶电极240可以为位线，电阻层230可沿该位线与两个或更多个存储单元连接。例如，电阻层230和顶电极240可横向延伸，从而将存储单元270连接于存储单元280。在一些实施方式中，顶电极240对应于用于所述半导体器件的其他连接结构的标准金属化层。虽然本发明实施方式将转变层220和电阻层230示为处于过孔250和顶电极240之间，但是在其他实施方式中，转变层220和电阻层230可位于半导体结构的任何过孔和任何金属层之间。
20.图3所示为根据一种实施方式具有非线性器件层的rram结构300。rram结构300可包括字线310。字线310可由导电材料形成，并可连接阵列段晶体管的栅极。所述导电材料的例子包括，但不限于，铜，钨或任何类似材料。字线310可与位线340正交，以下将对此进行进一步的详细描述。底电极310的上方可设置转变层320。转变层320可通过cvd，ald或任何合适方法设置。在一种实施方式中，转变层320可以为介电材料。在另一实施方式中，转变层320可以为tmo。在其他实施方式中，转变层320可以为hfox，taox，tiox或其他类似材料。转变层320可包括一个或多个氧空位360，该氧空位可用作导通转变层320的导电路径。氧空位360可通过在转变层320上施加电压的方式形成。转变层320可具有在施加电压时发生变化的电阻值。举例而言，当施加电压时，转变层320可在高电阻状态和低电阻状态之间切换。虽然转变层320图示为平面层，但是在一些实施方式中，转变层320也可如图2所示，沿位线340横向延伸。转变层320上方可设置电阻层330。电阻层330可通过cvd，ald或任何合适方法设置。在一种实施方式中，电阻层330可以为导电材料。在另一实施方式中，电阻层330可以为cmo。电阻层330可横向延伸，从而沿位线340与两个或更多个存储单元连接。例如，电阻层330和位线340可横向延伸，从而将存储单元370连接于存储单元380。
21.电阻层330上方可设置非线性器件层350。非线性器件层350可针对特定范围的电压呈现高电阻，并针对所述特定电压范围之上和之下的电压呈现低电阻范围。在一种实施方式中，所述电压范围可低于3伏。非线性器件层350可使得rram结构300呈现非线性电阻特性。在一些实施方式中，非线性器件层350可设于转变层320和字线310下方。在一种实施方式中，非线性器件层350可以为两个反向串联二极管。由于反向串联，在所述特定电压范围内，其中一个二极管的正向电流可被另一二极管隔绝。该特定电压范围可对应于此两二极管的击穿电压，其中，该击穿电压可以为致使所述二极管部分导电所需的最低电压。在另一实施方式中，非线性器件层350可以为金属-绝缘体-金属(mim)隧穿器件。电阻层330上方可设置位线340。位线340可以为导电材料。位线340可通过cvd，ald或任何合适方法设于电阻层330上方，从而在字线310和位线340的交叉处形成存储单元370，380。位线340可沿电阻层330横向延伸。
22.图4为根据一种实施方式用于制造rram结构的制造工艺流程图。需要注意的是，为了促进方法400的说明，下文描述中可使用图1～图3中的元件。方法400可实施为一项或多项操作。需要注意的是，方法400可以任何顺序实施，而且其操作既可与下文所述相同，也可有所增减。需要注意的是，方法400可由一台或多台半导体制造设备或制造机器实施。
23.在方法400中，首先如方框410所示，在基底上方形成转变层。在一种实施方式中，该基底可以为含有过孔的半导体装置。在另一实施方式中，所述转变层可设于存储结构的字线上方。该转变层可通过cvd，ald或任何合适的工艺设置。在一种实施方式中，该转变层可以为介电材料。在另一实施方式中，该转变层可以为tmo。在其他实施方式中，该转变层可以为hfox。如方框420所示，所述转变层上方可设置电阻层。该电阻层可通过cvd，ald或任何合适工艺设置。在一种实施方式中，该电阻层可以为导电材料。在另一实施方式中，该电阻层可以为cmo。如方框430所示，所述电阻层上方可设置顶电极层。该顶电极层可通过cvd，ald或任何合适工艺设置。在一种实施方式中，该顶电极层可以为导电材料。该导电材料的例子包括，但不限于，金，银，铜，钨或任何其他合适材料。
24.如方框440所示，所述顶电极层上表面上可设置能够抵抗刻蚀化学物质或等离子体的掩模材料。在一种实施方式中，该掩模材料可设置于所述顶电极层上表面的用于在当暴露于所述刻蚀化学物质或等离子体时形成rram结构顶电极(如位线)的部分。如方框450所示，可将所述rram结构暴露于刻蚀化学物质或等离子体中，以去除所述rram结构中暴露于所述掩模材料之外的区域。在一种实施方式中，所述刻蚀或等离子体工艺可仅去除所述顶电极层和所述电阻层的相应部分，而所述转变层仍保留为平面层。所述顶电极和所述电阻层可横向延伸，从而沿位线连接多个存储单元。在另一实施方式中，所述刻蚀或等离子体工艺可去除所述顶电极层、电阻层和转变层的相应部分。该顶电极层、电阻层和转变层可沿位线横向延伸，以连接多个存储单元。如方框460所示，可去除将所述顶电极上表面的所述掩模材料。
25.以上对本发明图示实施方式的描述(包括摘要中的描述内容)并不旨在穷举，或将本发明确切限制于所公开的各形式。虽然本技术出于说明目的描述了本发明的具体实施方式和实施例，但正如相关领域技术人员可认识到的一样，在本发明的范围内，还可进行各种等同修改。其他实施方式可具有与图示实施方式排列顺序不同的层，或者在图示实施方式的基础上对层数进行增减。
26.虽然以上为了以最有助于理解本发明的方式描述各项操作而将这些操作描述为多个独立的操作，但是该描述顺序不应被理解为暗示这些操作必然有赖于顺序。具体而言，这些操作无需一定以所述顺序实施。
27.本技术中，使用
″
之上
″
、
″
上方
″
、
″
下
″
、
″
之间
″
以及
″
上
″
这些词语指示一个材料层或部件与其他层或部件的相对位置。举例而言，当将一个层描述为沉积于另一层
″
上方
″
、
″
之上
″
或
″
下
″
时，表示该层既可与所述另一层直接接触，也可由一个或多个中间层将两者隔开。此外，当将一个层描述为沉积于两个层
″
之间
″
时，表示该层既可与所述两个层直接接触，也可由一个或多个中间层隔开。与此相反，当将第一层描述为处于第二层
″
上
″
时，表示其与该第二层直接接触。类似地，除非另有明确说明，当将一个构件描述为沉积于两个层
″
之间
″
时，表示该构件既可与所述各相邻构件直接接触，也可由一个或多个中间层隔开。
28.本技术中，
″
例
″
或
″
例示
″
两词用于表示作为示例，实例或例证。本技术中，描述为
″
例
″
或
″
例示
″
的任何方面或设计并不一定应理解为比其他方面或设计优选或更具优势。相反地，使用
″
例
″
或
″
例示
″
两词的目的在于以具体方式陈述概念。本技术中，
″
或
″
一词旨在表示包含意义上的
″
或
″
，而非排除意义上的
″
或
″
。也就是说，除非另有说明或从上下文中可明确看出，
″
x包括a或b
″
旨在表示自然的包容性排列组合方式当中的任何一种。也就是说，如果：
″
x包括a
″
；
″
x包括b
″
；或x同时包括a和b，则
″
x包括a或b
″
在上述任何一种情形下均得到满足。此外，本技术和所附权利要求书中未指定数目的名词可一般理解为其数目为
″
一个或多个
″
，除非另外明确指明，或从上下文中可明确看出为单个。另外，文中使用的
″
实施方式
″
或
″
一种实施方式
″
并不旨在表示同一实施方式，除非本身描述为具有此意。本技术中，
″
第一
″
，
″
第二
″
，
″
第三
″
，
″
第四
″
等词旨在用作区分不同元件的标记，并不一定具有其数字部分表示的序数含义。

技术特征：
1.一种阻变式随机存取存储器(rram)，其特征在于，包括：由钨构成的一个或多个底电极；一个或多个转变层，由设于所述一个或多个底电极上方的氧化铪构成，所述一个或多个转变层包括可转变细丝；设于所述一个或多个转变层上方的一个或多个电阻层；以及设于所述一个或多个转变层下方的过孔，其中，所述过孔与所述转变层直接接触且所述过孔包括钨。2.如权利要求1所述的rram，其特征在于，所述一个或多个电阻层由导电金属氧化物构成。3.如权利要求1所述的rram，其特征在于，还包括：设于所述一个或多个电阻层上方的一条或多条位线。4.如权利要求3所述的rram，其特征在于，所述一个或多个电阻层横向延伸，从而沿所述一条或多条位线连接两个以上rram单元。5.如权利要求3所述的rram，其特征在于，还包括：设于所述一条或多条位线下方和所述一个或多个电阻层上方的一个或多个非线性器件层。6.如权利要求5所述的rram，其特征在于，所述一个或多个非线性器件层包括金属-绝缘体-金属结构。7.如权利要求3所述的rram，其特征在于，所述一个或多个底电极包括与所述一条或多条位线正交的一条或多条字线。8.如权利要求7所述的rram，其特征在于，还包括：设于所述一条或多条字线上方和所述一个或多个转变层下方的一个或多个非线性器件层。9.如权利要求8所述的rram，其特征在于，所述一个或多个非线性器件层包括金属-绝缘体-金属结构。10.一种阻变式随机存取存储器(rram)，其特征在于，包括：一个或多个转变层；设于所述一个或多个转变层上方的一个或多个电阻层；设于所述一个或多个电阻层上方的一个或多个顶电极；以及设于所述一个或多个转变层下方的过孔，其中，所述过孔与所述一个或多个转变层直接接触且所述过孔包括钨。11.如权利要求10所述的rram，其特征在于，所述一个或多个转变层包括可转变细丝。12.如权利要求10所述的rram，其特征在于，还包括设于所述一个或多个转变层下方的一个或多个底电极。13.如权利要求12所述的rram，其特征在于，所述一个或多个底电极由钨构成。14.如权利要求10所述的rram，其特征在于，所述一个或多个转变层的材料包括过渡金属氧化物。15.如权利要求10所述的rram，其特征在于，所述一个或多个转变层的材料包括氧化钽。
16.如权利要求10所述的rram，其特征在于，所述一个或多个转变层的材料包括氧化钛。17.如权利要求10所述的rram，其特征在于，所述一个或多个转变层的材料包括氧化铪。18.如权利要求10所述的rram，其特征在于，所述一个或多个顶电极对应于用于半导体器件上的互连的金属化层。19.如权利要求10所述的rram，其特征在于，所述一个或多个转变层具有随电压的施加而变化的电阻。20.如权利要求10所述的rram，其特征在于，还包括：设于所述一个或多个电阻层上方的一条或多条位线，所述一个或多个电阻层横向延伸，从而沿所述一条或多条位线连接两个以上rram单元。

技术总结
本发明公开一种阻变式随机存取存储器(RRAM)。该RRAM包括由钨构成的一个或多个底电极；一个或多个转变层，由设于所述一个或多个底电极上方的氧化铪构成，所述一个或多个转变层包括可转变细丝；设于所述一个或多个转变层上方的一个或多个电阻层；以及设于所述一个或多个转变层下方的过孔，其中，所述过孔与所述转变层直接接触且所述过孔包括钨。转变层直接接触且所述过孔包括钨。转变层直接接触且所述过孔包括钨。


技术研发人员：吕志超 布伦特
受保护的技术使用者：合肥睿科微电子有限公司
技术研发日：2017.11.13
技术公布日：2023/9/19